去耦电容配置

按芯片类型生成分层去耦配置:每引脚 0.1µF / 芯片级 10µF / 板级大电容,含自谐振频率与安放原则

按芯片类型(MCU / FPGA / ADC / 运放 / 功率级)与供电引脚对数,生成「每引脚 0.1µF X7R 0402 + 芯片级 10µF + 板级 47~100µF」的分层去耦配置表并自动合计数量;配套等效阻抗小算:由容值与 ESL 计算自谐振频率 SRF = 1/(2π√(LC)),判断工作频段呈容性还是感性。全部计算在浏览器本地完成,最终以电源完整性仿真与实测纹波为准。

分层去耦配置生成

内核瞬态快,0.1µF 必须贴脚;多电源域(VDD/VADD/VDDA)各自独立配置。

数芯片上所有电源引脚对;如 48 脚 MCU 常见 5 对 VDD。每对至少配一颗 0.1µF

选型联动:主频越高,对封装电感与高频档的要求越高

层级
规格
数量
小计容值
每引脚去耦
0.1µF X7R 0402(C0G/X7R,贴脚安放)
×5
0.5 µF
芯片级储能
10µF X7R/X5R 0805(靠近芯片居中)
×1
10 µF
板级储能
47µF 固态/钽/电解(电源入口)
×1
47 µF
合计(7 颗)
57.5 µF

高频适配提示(主频 168MHz)

频段-阻抗注记(按本配置各层 ESL 估算)

DC ~ 0.33MHz板级大电容主导:负责储能与低频纹波,关键参数是 ESR 与容量而非频率响应
~ 1.59MHz芯片级 10µF 主导:中频段过渡,补大电容高频不足与 0.1µF 低频不足之间的谷
~ 22.51MHz0.1µF 低阻抗窗口:主去耦频段,快速瞬态电流由此就近提供
> 22.51MHz封装电感主导:0.1µF 已呈感性,靠电源-地平面电容与小封装(0402/0201)多档并联拉宽带宽

等效阻抗小算 · 自谐振频率

SRF = 1 / (2π√(LC))

22.51 MHz

f=1MHz:容性区,|Z|≈1.59Ω,正常去耦

超过 SRF 呈感性;等效 ESL:0402 约 0.5nH、0805 约 1nH、电解/大容量约 5nH

布局三原则

1

贴近引脚

0.1µF 距电源引脚越近越好(<2mm 量级),电流先过电容再到芯片,别让走线把电容"甩"在支路上。

2

环路最小

电容-引脚-地的回路面积决定等效电感,电源脚与地脚同侧就近打地过孔,回流路径同层闭合。

3

过孔优先

电容焊盘就近双过孔入地平面优于任何长走线;先过孔后拉线,过孔打在焊盘上(via-in-pad)最优。

快速自核示例

本工具按典型 ESL 与经验配比快速估算,实际阻抗还受 ESR、直流偏压降容、温度与平面形状影响。关键设计请以 PI 仿真(阻抗曲线目标法)与实测电源纹波为准。

#去耦电容配置原理与用法

0.1µF 从哪来:为什么是它而不是别的值

0.1µF 不是魔法数字,而是「容值 × 自谐振频率 × 成本」折中的历史产物。X7R 0402 的 0.1µF 配上约 0.5nH 封装电感,自谐振频率恰在 20~30MHz——正好覆盖 MCU IO 翻转与多数芯片内核瞬态的主频段;再往上(100MHz 以上)它已经呈感性,靠的不是更大容值而是更小封装与平面电容。同时 0.1µF 在常用容值档里单价最低、可一颗颗贴满每个电源脚。容值-频率-ESL 的关系可用本页侧栏的自谐振小算验证,术语细节参见 去耦电容词条。

去耦电容不是越大越好

大容值意味着低自谐振频率与更大封装(更高 ESL):一颗 10µF 0805 的 SRF 只有 1~2MHz,在 50MHz 下它是感性开路,帮不上任何忙。去耦的目标是「在需要的频段把电源阻抗压到目标值以下」,所以要用小容值覆盖高频、中容值补过渡、大容值管储能的分层组合——每层各管一段频谱,并联起来拉宽低阻抗区间。把 0.1µF 全换成 10µF,高频纹波反而会更差。

平面电容:GHz 段的最后防线

电源平面与地平面构成的平行板电容没有引线电感,其"自谐振"频率极高,是 100MHz~1GHz 频段唯一可靠的去耦手段。缩小两平面间距(层压 0.1mm 以内)、加大重叠面积都能提升平面电容;这也是高速板把电源-地对紧耦合布置的直接原因。当芯片封装内已集成电源平面(如 BGA 内部电容、IPD)时,板上离散电容的压力会小很多。

去耦 vs 旁路:一字之差

去耦(decoupling)指把芯片与电源系统"解耦":在芯片引脚就近提供瞬态电流蓄水池,让开关噪声留在局部回路而不污染整个电源轨;旁路(bypass)指把噪声分流到地,让电源上的高频分量绕过负载。同一个 0.1µF 电容两种角色都在扮演——对电源轨它是旁路(把噪声导到地),对芯片它是去耦(就近供能)。工程口语里两词常混用,配置方法一致。

常见问题(FAQ)

  • 为什么每个电源引脚都要一颗 0.1µF?瞬态电流必须就近取用,走线每毫米都在加电感;两引脚共用一颗等于把环路拉长一倍,高频去耦效果大打折扣。
  • 板级大电容选电解还是固态?优先低 ESR 固态/钽;电解便宜但 ESR 高、寿命受温度影响,适合低成本消费类。容量按最坏瞬态持续时间 × 允许压降估算。
  • X7R 的直流偏压降容要不要管?要。0.1µF X7R 0402 在 3.3V 偏压下实际容量可能只剩 60~80%,关键场合按降容后的容值核算 SRF,或选大一档/换 C0G。
  • 0.1µF、10µF、47µF 距离芯片多远合适?0.1µF 必须 <2mm 量级贴着引脚;10µF 可放宽到 1~2cm;板级大电容只管储能,放电源入口即可。

本工具为快速估算,实际以 PI 仿真与实测纹波为准。

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